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第27页：DDR3详细改进之处

JEDEC（内存工业标准组织）确立DDR3的标准主要为，8 bit 预取设计，较 DDR2 4bit 的预取设计提升一倍，其运算频率介于 800MHz -1600MHz之间 。

SDRAM=>DDR=>DDR2=>DDR3最大的改进就是预取位数在不断的增加，而内核频率却没有什么变化 ，所以随着制程的改进，电压和功耗可以逐步降低。

此外，DDR3 的规格要求将电压控制在 1.5V ，较 DDR2 的 1.8V 更为省电。此外， DDR3 采用 ASR(Automatic self-refresh) 的设计，以确保在数据不遗失情况下，尽量减少更新频率来降低温度。
　　 计划DDR3将于今年底或明年初正式导入市场，不过从其具体的设计来看，DDR3与DDR2的基础架构并没有本质的不同。从某种角度讲，DDR3是为了解决DDR2发展所面临的限制而催生的产物。由于DDR2的数据传输频率发展到800MHz时，其内核工作频率已经达到200MHz，因此再向上提升较为困难，这就需要采用新的技术来保证速度的可持续发展性。另一方面，也是由于速度提高的缘故，内存的地址/命令与控制总线需要有全新的拓朴结构，而且业界也要求内存要具有更低的能耗，所以，DDR3必须满足一系列要求：
　　 ·更高的外部数据传输率
　　 ·更先进的地址/命令与控制总线的拓朴架构
　　 ·在保证性能的同时将能耗进一步降低
　　 ·为了满足上述要求，DDR3在DDR2的基础上采用了以下新型设计：
　　 ·8bit预取设计，DDR2为4bit预取，这样DRAM内核的频率只有接口频率的1/8，DDR3-800的核心工作频率只有100MHz
　　 ·采用点对点的拓朴架构，减轻地址/命令与控制总线的负担
　　 ·采用100nm以下的生产工艺，将工作电压从1.8V降至1.5V，增加异步重置（Reset）与ZQ校准功能

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WolStame 　北京 2007年06月04日